书目信息 |
题名: |
Verilog HDL高级数字设计
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作者: | 西勒提 著 ;李广军 , 林水生 , 阎波 译 | |
分册: | ||
出版信息: | 北京 电子工业出版社 2019.01 |
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页数: | 14, 649页 | |
开本: | 26cm | |
丛书名: | 国外电子与通信教材系列 | |
单 册: | ||
中图分类: | TP312VH | |
科图分类: | ||
主题词: | VHDL语言--VHDLyu yan--程序设计--教材 | |
电子资源: | ||
ISBN: | 978-7-121-22193-4 |
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200 | 1 | @aVerilog HDL高级数字设计@AVerilog HDLgao ji shu zi she ji@d= Advanced digital design with the Verilog HDL@f(美) Michael D. Ciletti著@F(mei) michael d. cilettizhu@g李广军, 林水生, 阎波等译@zeng |
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225 | 2 | @a国外电子与通信教材系列@Aguo wai dian zi yu tong xin jiao cai xi lie |
305 | @a译自原书第2版 | |
306 | @a本书中文简体字版专有出版权由Pearson Education (培生教育出版集团) 授予电子工业出版社 | |
314 | @a责任者规范汉译姓: 西勒提 | |
314 | @aMichael D. Ciletti, 美国科罗拉多大学电气与计算机工程系退休教授。 | |
320 | @a有书目 | |
330 | @a本书依据数字集成电路系统工程开发的要求与特点, 利用Verilog HDL对数字系统进行建模、设计与验证, 对ASIC/FPGA系统芯片工程设计开发的关键技术与流程进行了深入讲解, 内容包括: 集成电路芯片系统的建模、电路结构权衡、流水线技术、多核微处理器、功能验证、时序分析、测试平台、故障模拟、可测性设计等。 | |
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Verilog HDL高级数字设计= Advanced digital design with the Verilog HDL/(美) Michael D. Ciletti著/李广军, 林水生, 阎波等译.-北京:电子工业出版社,2019.01 |
14, 649页:图;26cm.-(国外电子与通信教材系列) |
ISBN 978-7-121-22193-4:CNY115.00 |
本书依据数字集成电路系统工程开发的要求与特点, 利用Verilog HDL对数字系统进行建模、设计与验证, 对ASIC/FPGA系统芯片工程设计开发的关键技术与流程进行了深入讲解, 内容包括: 集成电路芯片系统的建模、电路结构权衡、流水线技术、多核微处理器、功能验证、时序分析、测试平台、故障模拟、可测性设计等。 |
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正题名:Verilog HDL高级数字设计
索取号:TP312VH/X066
 
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